河南PCI-E测试方案商

时间:2023年07月24日 来源:

PCIe4.0的发射机质量测试发射机质量是保证链路能够可靠工作的先决条件,对于PCIe的发射机质量测试来说,主要是用宽带示波器捕获其发出的信号并验证其信号质量满足规范要求。按照目前规范中的要求,PCIe3.0的一致性测试需要至少12.5GHz带宽的示波器;而对于PCIe4.0来说,由于数据速率提高到了16Gbps,所以测试需要的示波器带宽应为25GHz或以上。如果要进行主板的测试,测试规范推荐Dual-Port(双口)的测试方式,即把被测的数据通道和参考时钟同时接入示波器,这样在进行抖动分析时就可以把一部分参考时钟中的抖动抵消掉,对于参考时钟Jitter的要求可以放松一些。PCIE 系统架构及物理层一致性测试;河南PCI-E测试方案商

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PCIe背景概述PCIExpress(PeripheralComponentInterconnectExpress,PCle)总线是PCI总线的串行版本,广泛应用于显卡、GPU、SSD卡、以太网卡、加速卡等与CPU的互联。PCle的标准由PCI-SIG(PCISpecialInterestGroup)组织制定和维护,目前其董事会主要成员有Intel、AMD、nVidia、DellEMC、Keysight、Synopsys、ARM、Qualcomm、VTM等公司,全球会员单位超过700家。PCI-SIG发布的规范主要有Base规范(适用于芯片和协议)、CEM规范(适用于板卡机械和电气设计)、测试规范(适用于测试验证方法)等,目前产业界正在逐渐商用第5代版本,同时第6代标准也在制定完善中。由于组织良好的运作、的芯片支持、成熟的产业链,PCIe已经成为服务器和个人计算机上成功的高速串行互联和I/O扩展总线。图4.1是PCIe总线的典型应用场景。黑龙江PCI-E测试销售价格PCI-E转USB或UFS接口的控制芯片和测试板的制作方法;

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PCIe4.0的测试夹具和测试码型要进行PCIe的主板或者插卡信号的一致性测试(即信号电气质量测试),首先需要使用PCIe协会提供的夹具把被测信号引出。PCIe的夹具由PCI-SIG定义和销售,主要分为CBB(ComplianceBaseBoard)和CLB(ComplianceLoadBoard)。对于发送端信号质量测试来说,CBB用于插卡的测试,CLB用于主板的测试;但是在接收容限测试中,由于需要把误码仪输出的信号通过夹具连接示波器做校准,所以无论是主板还是插卡的测试,CBB和CLB都需要用到。网络分析仪测试PCIe gen4和gen5,sdd21怎么去除夹具的值?

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由于每对数据线和参考时钟都是差分的,所以主  板的测试需要同时占用4个示波器通道,也就是在进行PCIe4.0的主板测试时示波器能够  4个通道同时工作且达到25GHz带宽。而对于插卡的测试来说,只需要把差分的数据通道  引入示波器进行测试就可以了,示波器能够2个通道同时工作并达到25GHz带宽即可。 12展示了典型PCIe4.0的发射机信号质量测试环境。无论是对于发射机测试,还是对于后面要介绍到的接收机容限测试来说,在PCIe4.0 的TX端和RX端的测试中,都需要用到ISI板。ISI板上的Trace线有几十对,每相邻线对 间的插损相差0.5dB左右。由于测试中用户使用的电缆、连接器的插损都可能会不一致, 所以需要通过配合合适的ISI线对,使得ISI板上的Trace线加上测试电缆、测试夹具、转接  头等模拟出来的整个测试链路的插损满足测试要求。比如,对于插卡的测试来说,对应的主  板上的比较大链路损耗为20dB,所以ISI板上模拟的走线加上测试夹具、连接器、转接头、测  试电缆等的损耗应该为15dB(另外5dB的主板上芯片的封装损耗通过分析软件进行模拟)。 为了满足这个要求,比较好的方法是使用矢量网络分析仪(VNA)事先进行链路标定。在PCI-E的信号质量测试中需要捕获多少的数据进行分析?多端口矩阵测试PCI-E测试联系方式

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是用矢量网络分析仪进行链路标定的典型连接,具体的标定步骤非常多,在PCIe4.0 Phy Test Specification文档里有详细描述,这里不做展开。

在硬件连接完成、测试码型切换正确后,就可以对信号进行捕获和信号质量分析。正式 的信号质量分析之前还需要注意的是:为了把传输通道对信号的恶化以及均衡器对信号的 改善效果都考虑进去,PCIe3.0及之后标准的测试中对其发送端眼图、抖动等测试的参考点 从发送端转移到了接收端。也就是说,测试中需要把传输通道对信号的恶化的影响以及均 衡器对信号的改善影响都考虑进去。 河南PCI-E测试方案商

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