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FPGA的逻辑就是由阵列排布的CLB实现的，每个CLB单元都和一个开关阵列相连，并受其控制以实现逻辑，如下图所示每一个CLB中包含有两个基本结构（Slice），每个基本结构中包含4个查找表（LUT）、4个存储单元、广函数多路器（Wide_functionMultiplexer）和进位逻辑，这种基本结构（Slice）称为SLICEL。另外，有些基本结构（Slice）中还包含使用RAM存储数据的功能和使用32位寄存器移位的功能，支持这些功能的基本结构称为SLICEM。2、时钟管理模块（CMT）时钟管理模块（CMT）用于产生高质量的时钟，以Virtex-5系列器件为例，CMT包括两个数字时钟管理单元（DCM）和一个锁相环电路（PLL）。 Xilinx公司正是凭借Vitex系列产品赢得市场。盐田官方授权XILINXXC5VLX50T-1FFG1136I
可编程逻辑器件是通过EDA技术将电子应用系统的既定功能和技术指标具体实现的硬件载体，FPGA作为实现这一途径的主流器件之一，具有直接面向用户，灵活性和通用性极大，使用方便，硬件测试和实现快捷等特点。硬件描述语言（HDL）是一种用来设计数字逻辑系统和描述数字电路的语言，常用的主要有VHDL、VerilogHDL、SystemVerilog和SystemC。作为一种多方位的硬件描述语言，超高速集成电路硬件描述语言（VHDL）具有与具体硬件电路无关、与设计平台无关的特性，具有宽范围描述能力、不依赖于特定的器件、可将复杂控制逻辑的设计用严谨简洁的代码进行描述等优点，得到众多EDA公司的支持，在电子设计领域得到了广泛应用。 广东**XILINXXC7K160T-1FBG484C在Xilinx公司的FPGA器件中，CLB由多个（一般为4个或2个）相同的Slice和附加逻辑构成。
FPGA采用了逻辑单元阵列LCA（LogellArray）这样一个概念，内部包括可配置逻辑模CLB（ConfigurableLogicBlock）、输入输出模块IOB（InputOutputBlock）和内部连线erconnect）三个部分。现场可编程门阵列（FPGA）是可编程器件，与传统逻辑电路和门阵列（如PAL，GAL及CPLD器件）相比，FPGA具有不同的结构。FPGA利用小型查找表（16×1RAM）来实现组合逻辑，每个查找表连接到一个D触发器的输入端，触发器再来驱动其他逻辑电路或驱动I/O，由此构成了既可实现组合逻辑功能又可实现时序逻辑功能的基本逻辑单元模块，这些模块间利用金属连线互相连接或连接到I/O模块。
另外就是关于块RAM，Xilinx的双口RAM是真的，Altera的没有双口RAM，如果你要实现真正的双口RAM，只能用两块RAM来背靠背地实现，这样你的RAM资从1985年Xilinx公司推出较早片FPGA到现在，FPGA的使用已经有近30年的历史了。目前主流市场的FPGA主要还是Xilinx和Altera两大系列，下面分别来介绍下它们各自的基本结构组成。Xilinx的FPGA主要由以下单元结构组成：可配置逻辑块（CLB）、时钟管理模块（CMT）、存储器（RAM/FIFO）、数字信号处理模块（DSP）和一些**模块。以Virtex-5为例，简单介绍下各模块的功能。源就少了一半，如果你的应用对片内双口RAM的需求很重要，用Altera的就划不来。 CLB的实际数量和特性会依器件的不同而不同。
存储器模块（RAM）StratixII器件具有TriMatrix存储结构，它包括3种大小的嵌入式RAM块。TriMatrix存储器包括512位的M512块、4Kb的M4K块和512Kb的M-RAM块，每个都可以配置支持各种特性。、数字信号处理模块（DSP）DSP块结构是为实现多种比较大性能和**小逻辑资源利用率的DSP功能而优化的。、锁相环（PLL）StratixII器件具有多达12个锁相环（PLL）和48个**系统时钟，可以作为**时钟管理器满足系统时序需求。以上可以看出，Xilinx与Altera的FPGA的结构比较大不同还是其逻辑单元部分：Xilinx的逻辑单元基本组成为可配置逻辑模块（CLB），而Altera的为LAB，但更深一层讲，CLB和LAB里面也都是由LUT、触发器等构成的。两个公司的FPGA组成各有特点，这也决定了它们的FPGA产品在功能上各有特点。 Xilinx在Business W S&P500表现比较好的50家公司中名列前列，并被福布斯杂志评为400个比较好的大公司之一。罗湖**XILINXXC7K325T-2FFG900I
Xilinx与Altera的FPGA区别。两家FPGA的区别有两方面：1.基本逻辑资源；2.内部基本架构。盐田官方授权XILINXXC5VLX50T-1FFG1136I
XILINX中FPGA的优点如下：
(1) FPGA由逻辑单元、RAM、乘法器等硬件资源组成，通过将这些硬件资源合理组织，可实现乘法器、寄存器、地址发生器等硬件电路。
(2) FPGA可通过使用框图或者Verilog HDL来设计，从简单的门电路到FIR或者FFT电路。
(3) FPGA可无限地重新编程，加载一个新的设计方案只需几百毫秒，利用重配置可以减少硬件的开销。
(4) FPGA的工作频率由FPGA芯片以及设计决定，可以通过修改设计或者更换更快的芯片来达到某些苛刻的要求（当然，工作频率也不是无限制的可以提高，而是受当前的IC工艺等因素制约）。
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